STM32F469 datasheet(6/91 Pages) STMICROELECTRONICS

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AN4861

6/91

DocID029237 Rev 2

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Figure 1.

Basic embedded graphic system . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8

Figure 2.

Display module with embedded controller and GRAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

Figure 3.

Display module without controller nor GRAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10

Figure 4.

Display module without controller nor GRAM and with external framebuffer . . . . . . . . . . . 10

Figure 5.

MIPI-DBI type A or B interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11

Figure 6.

MIPI-DBI type C interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11

Figure 7.

MIPI-DPI interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12

Figure 8.

MIPI-DSI interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12

Figure 9.

LTDC AHB master in STM32F429/439 and STM32F469/479 lines

smart architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17

Figure 10.

LTDC AHB master in STM32F7x6, STM32F7x7, STM32F7x8 and STM32F7x9

smart architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

Figure 11.

LTDC Block digram. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

Figure 12.

LTDC signal interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22

Figure 13.

Typical LTDC display frame (active width = 480 pixels) . . . . . . . . . . . . . . . . . . . . . . . . . . . 23

Figure 14.

Fully programmable timings and resolutions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

Figure 15.

LTDC fully programmable display resolution with

total width up to 4096 pixels and total height up to 2048 lines . . . . . . . . . . . . . . . . . . . . . . 25

Figure 16.

Blending two layers with a background . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26

Figure 17.

Layer window programmable size and position . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26

Figure 18.

Pixel data mapping versus color format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

Figure 19.

Programmable color layer in framebuffer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

Figure 20.

Pixel format conversion from RGB565 input pixel format to the internal

ARGB8888 format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

Figure 21.

AHB masters concurrent access to SDRAM. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

Figure 22.

Typical graphic hardware configuration with external SDRAM . . . . . . . . . . . . . . . . . . . . . . 36

Figure 23.

Double buffering: synchronizing LTDC with DMA2D or CPU . . . . . . . . . . . . . . . . . . . . . . . 42

Figure 24.

Example of taking advantage from memory slaves split

on the STM32F4x9 line MCUs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43

Figure 25.

Burst access crossing the kilobyte boundary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

Figure 26.

Reducing layer window and framebuffer line widths. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

Figure 27.

Adding dummy bytes to make the line width multiple of 64 bytes. . . . . . . . . . . . . . . . . . . . 47

Figure 28.

Placing the two buffers in independent SDRAM banks . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

Figure 29.

FMC SDRAM and NOR/PSRAM memory swap at default

system memory map (MPU disabled). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51

Figure 30.

Connecting an RGB666 display panel . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53

Figure 31.

Low-end graphic implementation example . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

Figure 32.

High-end graphic implementation example . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

Figure 33.

Graphic hardware configuration in the STM32F746G-DISCO . . . . . . . . . . . . . . . . . . . . . . 64

Figure 34.

LCD-TFT connection in the STM32F746G-DISCO board . . . . . . . . . . . . . . . . . . . . . . . . . 65

Figure 35.

Backlight controller module. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 66

Figure 36.

STM32CubeMX: LTDC GPIOs configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 68

Figure 37.

STM32CubeMX: PJ7 pin configuration to LTDC_G0 alternate function . . . . . . . . . . . . . . . 68

Figure 38.

STM32CubeMX: LTDC configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

Figure 39.

STM32CubeMX: LTDC GPIOs output speed configuration . . . . . . . . . . . . . . . . . . . . . . . . 69

Figure 40.

STM32CubeMX: display enable pin (LCD_DISP) configuration . . . . . . . . . . . . . . . . . . . . . 70

Figure 41.

STM32CubeMX: setting LCD_DISP pin output level to high . . . . . . . . . . . . . . . . . . . . . . . 70

Figure 42.

STM32CubeMX: enabling LTDC global and error interrupts . . . . . . . . . . . . . . . . . . . . . . . 71

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