UM0434 datasheet(7/390 Pages) STMICROELECTRONICS

7 / 390 page

UM0434

Table of contents

7/391

7.3.2

Replacement algorithm for TLB1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199

7.3.3

The G bit (of WIMGE) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199

7.3.4

TLB entry field summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199

7.4

Software interface and TLB instructions . . . . . . . . . . . . . . . . . . . . . . . . . 200

7.5

TLB operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 201

7.5.1

Translation reload . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202

7.5.2

Reading the TLB . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202

7.5.3

Writing the TLB . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202

7.5.4

Searching the TLB . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202

7.5.5

TLB coherency control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202

7.5.6

TLB miss exception update . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203

7.5.7

TLB load on reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203

7.6

MMU configuration and control registers . . . . . . . . . . . . . . . . . . . . . . . . 203

7.6.1

MMU configuration register (MMUCFG) . . . . . . . . . . . . . . . . . . . . . . . 204

7.6.2

TLB0 and TLB1 configuration registers . . . . . . . . . . . . . . . . . . . . . . . . 204

7.6.3

Data exception address register (DEAR) . . . . . . . . . . . . . . . . . . . . . . . 204

7.6.4

MMU control and status register 0 (MMUCSR0) . . . . . . . . . . . . . . . . . 204

7.6.5

MMU assist registers (MAS) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 204

7.7

Effect of hardware debug on MMU operation . . . . . . . . . . . . . . . . . . . . . 205

Instruction pipeline and execution timing . . . . . . . . . . . . . . . . . . . . . 206

8.1

Overview of operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 206

8.1.1

Control unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 207

8.1.2

Instruction unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 207

8.1.3

Branch unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 208

8.1.4

Instruction decode unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 208

8.1.5

Exception handling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 208

8.2

Execution units . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 208

8.2.1

Integer execution unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 208

8.2.2

Load/Store unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 208

8.3

Instruction pipeline . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 209

8.3.1

Description of pipeline stages . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 209

8.3.2

Instruction buffers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 210

8.3.3

Single-Cycle instruction pipeline operation . . . . . . . . . . . . . . . . . . . . . 212

8.3.4

Basic load and store instruction pipeline operation . . . . . . . . . . . . . . . 212

8.3.5

Change-of-Flow instruction pipeline operation . . . . . . . . . . . . . . . . . . 213

UM0434 Arkusz danych(PDF) 7 Page - STMicroelectronics

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