UM0434 datasheet(2/390 Pages) STMICROELECTRONICS

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UM0434

2/391

Table of contents

Organization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

1.1

Bibliography . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

1.2

Related documentation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21

1.3

Audience . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21

Conventions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22

2.1

Terminology conventions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22

2.2

Acronyms and abbreviations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23

e200z3 core complex overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

3.1

Overview of the e200z3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

3.1.1

Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

3.2

Programming model . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26

3.2.1

3.3

Instruction set . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

3.4

VLE APU . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

3.5

Interrupts and exception handling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

3.5.1

Interrupt handling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

3.5.2

Interrupt classes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

3.5.3

Interrupt types . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

3.5.4

Interrupt registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

3.6

Microarchitecture summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

3.6.1

Instruction unit features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

3.6.2

Integer unit features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

3.6.3

Load/Store unit (LSU) features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

3.6.4

Memory management unit (MMU) features . . . . . . . . . . . . . . . . . . . . . . 34

3.6.5

System bus (core complex interface) features . . . . . . . . . . . . . . . . . . . . 35

3.6.6

Nexus3 module features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

3.7

Legacy support of PowerPC architecture . . . . . . . . . . . . . . . . . . . . . . . . . 35

3.7.1

Instruction set compatibility . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

3.7.2

Memory subsystem . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

3.7.3

Interrupt handling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

3.7.4

Memory management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

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